Intel C220 Chipsätze
Intel C220 Chipsätze (Codename Lynx Point) kommen bei Single-CPU Server- und Workstation-Mainboards für Intel Xeon E3-1200 v3 CPUs (Haswell Mikroarchitektur) zum Einsatz. Sie sind damit die Nachfolger der C200 Chipsätze, die für CPUs der Sandy Bridge und Ivy Bridge Intel Mikroarchitekturen verwendet werden.
C220 Chipsätze im Überblick
Die C220 Serie setzt sich aus drei Chipsätzen zusammen:
C222 | C224 | C226 | |
---|---|---|---|
Flexible I/O | - | - | ✔ |
PCI Express 2.0 Ports | 8 | 8 | 8 |
Gesamtzahl USB Ports
|
10 2 8 |
12 4 8 |
14 4-6(*) 10-8(*) |
Gesamtanzahl SATA Ports
|
6 2 4 |
6 4 2 |
4-6(*) 4-6(*) 0 |
VGA | - | - | ✔ |
Intel Wireless Display | - | - | ✔ |
Intel Rapid Storage Technology - AHCI | ✔ | ✔ | ✔ |
Intel Rapid Storage Technology - RAID 0/1/5/10 Unterstützung | ✔ | ✔ | ✔ |
Intel Rapid Storage Technology - Intel Smart Response Technology | - | - | ✔ |
Intel Active Management Technology 9.0 | - | - | ✔ |
Intel Identity Protection Technology (Intel IPT) | - | - | ✔ |
(*) abhängig von Flexible I/O Konfiguration des Mainboard Designers
Neuerungen gegenüber C200
Die Intel C220 Chipsatz Generation bietet folgende Neuerungen:[1]
- USB 3.0
- Intel Flexible I/O
- Intel Rapid Storage Technology 2.0
- Bis zu 6x 6Gb/s SATA Ports
- PCI Express Latency Tolerance Reporting (LTR)
- Der PCI Express Root Port unterstützt LTR.
- Endgeräte berichten dynamisch an den Root Port über ihre Service Latenz Anforderungen an den Speicherzugriff.
- Immer wenn sich die Latenz Toleranz ändert sowie beim beim Bootvorgang sollten Endgeräte eine neue LTR Nachricht an den Root Port übertragen.
- Der PCH nutzt diese Informationen um bessere Powermanagement Entscheidungen zu treffen.
- Der Prozessor nutzt den Worst-Case Wert der übermittelten Toleranzwerte um die Übergänge zwischen den Energiezuständen (c-states) zu optimieren.
- Dies führt zu einem verbesserten Powermanagement ohne die Endgerätefunktion zu beeinflussen.
- Endgeräte, die LTR unterstützen müssen den "reporting and enable mechanism" laut PCIe Latency Tolerance Reporting Engineering Change Notice implementieren.
- Neuerungen beim Serial Peripheral Interface (SPI)
- Unterstützt Quad IO Fast Read, Quad Output Fast Read, Dual IO Fast Read
- Unterstützung von TPM over SPI
- Unterstützt Serial Flash Discoverable Parameter (SFDP)
Einzelnachweise
- ↑ Intel® 8/C220 Series Chipset Platform Controller Hub: Datasheet (www.intel.com)
Weitere Informationen
- Wandelbare Verwaltungsmaschine Das leistet die „Management Engine“ in Intel-Chipsätzen (c't 13/2014, Seite 138)
- Intel® Xeon® Processor E3-1200 v3 Product Family with Intel® HD Graphics P4600 and Intel® C226 Chipset (www.intel.com)
- Intel Xeon Processor E3-1200 v3 Product Family-based Platforms for Intelligent Systems (www.intel.com)
- 4th Generation Intel® Core™ Processor-Based Platforms for Intelligent Systems (www.intel.com)
- Haswell-based Xeon chipsets (en.wikipedia.org)
Autor: Thomas Niedermeier Thomas Niedermeier arbeitet im Product Management Team von Thomas-Krenn. Er absolvierte an der Hochschule Deggendorf sein Studium zum Bachelor Wirtschaftsinformatik. Seit 2013 ist Thomas bei Thomas-Krenn beschäftigt und kümmert sich unter anderem um OPNsense Firewalls, das Thomas-Krenn-Wiki und Firmware Sicherheitsupdates. |